逻辑综合
概述
逻辑综合是将电路的行为级描述,特别是RTL级描述转化成为门级表达的过程。例如VHDL、Verilog综合就属于逻辑综合。
2 扩展释义
逻辑综合是将电路的行为级描述,特别是RTL级描述转化成为门级表达的过程。例如VHDL、Verilog综合就属于逻辑综合。
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本词条最后更新于 2026-07-10 12:20:02
逻辑综合是将电路的行为级描述,特别是RTL级描述转化成为门级表达的过程。例如VHDL、Verilog综合就属于逻辑综合。
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